Altera FPGA/CPLD设计

第1章 fpga/cpld简介

1.1 可编程逻辑设计技术简介

1.1.1 可编程逻辑器件发展简史

1.1.2 可编程逻辑器件分类

1.2 fpga/cpld的基本结构

1.2.1 fpga的基本结构

1.2.2 cpld的基本结构

1.2.3 fpga和cpld的比较

1.3 fpga/cpld的设计流程

1.4 fpga/cpld的常用开发工具

1.5 下一代可编程逻辑设计技术展望

1.5.1 下一代可编程逻辑器件硬件上的四大发展趋势

1.5.2 下一代eda软件设计方法发展趋势

1.6 小结

1.7 问题与思考

第2章 altera fpga/cpld的结构

2.1 altera高密度fpga

2.1.1 主流高端fpga——stratix iv e/gx/gt

2.1.2 内嵌10gbit/s高速串行收发器的fpga——stratix iv gt

2.1.3 内嵌高速串行收发器的中端fpga——arriaii gx

2.2 altera低成本fpga

2.3 altera的cpld器件

2.4 小结

2.5 问题与思考

第3章 altera quartus ii开发流程

3.1 quartus ii软件综述

3.1.1 quartus ii软件的特点及支持的器件

3.1.2 quartus ii软件的工具及功能简介

3.1.3 quartus ii软件的用户界面

3.2 设计输入

3.2.1 设计输入方式

3.2.2 设计规划

3.2.3 设计输入文件实例

3.2.4 设计约束

3.3 综合

3.3.1 使用quartus ii软件集成综合

3.3.2 控制综合

3.3.3 综合实例

3.3.4 第三方综合工具

3.4 布局布线

3.4.1 设置布局布线参数

3.4.2 布局布线实例

3.4.3 增量布局布线

3.4.4 反标保留分配

3.5 仿真

3.5.1 指定仿真器设置

3.5.2 建立矢量源文件

3.5.3 仿真实例

3.5.4 第三方仿真工具

3.6 编程与配置

3.6.1 建立编程文件

3.6.2 器件编程和配置

3.7 小结

3.8 问题与思考

第4章 altera的ip工具

4.1 ip的概念和altera的ip

4.1.1 ip的概念

4.1.2 altera可提供的ip

4.1.3 altera ip在设计中的作用

4.2 使用altera的基本宏功能

4.2.1 定制基本宏功能

4.2.2 实现基本宏功能

4.2.3 设计实例

4.3 使用altera的ip核

4.3.1 定制ip核

4.3.2 实现ip核

4.3.3 设计实例

4.4 小结

4.5 问题与思考

第5章 quartus ii的常用辅助设计工具

5.1 i/o分配验证

5.1.1 i/o分配验证功能简介

5.1.2 i/o分配验证流程

5.1.3 用于i/o分配验证的输入

5.1.4 运行i/o分配验证

5.2 功率分析

5.2.1 excel-based功率计算器

5.2.2 simulation-based功率估算

5.3 rtl阅读器

5.3.1 rtl阅读器简介

5.3.2 rtl阅读器用户界面

5.3.3 原理图的分页和模块层次的切换

5.3.4 过滤原理图

5.3.5 将原理图中的节点定位到源设计文件

5.3.6 在原理图中查找节点或网线

5.3.7 使用rtl阅读器分析设计中的问题

5.4 signalprobe及signaltap ii逻辑分析器

5.4.1 signalprobe

5.4.2 signaltap ii逻辑分析器

5.5 时序收敛平面布局规划器(timing closure floorplan)

5.5.1 使用timing closure floorplan分析设计

5.5.2 使用timing closure floorplan优化设计

5.6 chip editor底层编辑器

5.6.1 chip editor功能简介

5.6.2 使用chip editor的设计流程

5.6.3 chip editor视图

5.6.4 资源特性编辑器

5.6.5 chip editor的一般应用

5.7 工程更改管理(eco)

5.7.1 eco简介

5.7.2 eco的应用范围

5.7.3 eco的操作流程

5.7.4 使用change manager查看和管理更改

5.7.5 eco验证

5.8 小结

5.9 问题与思考

第6章 编程与配置

6.1 配置altera fpga

6.1.1 配置方式

6.1.2 主动串行(as)

6.1.3 被动串行(ps)

6.1.4 快速被动并行(fpp)

6.1.5 被动并行异步(ppa)

6.1.6 jtag配置方式

6.1.7 byteblaster ii下载电缆

6.1.8 配置芯片

6.2 配置文件和软件支持

6.2.1 软件支持

6.2.2 配置文件

6.3 单板设计及调试注意事项

6.3.1 配置的可靠性

6.3.2 单板设计要点

6.3.3 调试建议

6.4 小结

6.5 问题与思考

第7章 第三方eda工具

7.1 第三方eda工具综述

7.1.1 nativelink与wysiwyg

7.1.2 3种eda工具的使用流程

7.1.3 quartus ii支持的第三方工具

7.2 仿真的概念与modelsim仿真工具

7.2.1 仿真简介

7.2.2 仿真的切入点

7.2.3 modelsim仿真工具的不同版本

7.2.4 modelsim的图形用户界面

7.2.5 modelsim的基本仿真步骤

7.2.6 使用modelsim进行功能仿真

7.2.7 使用modelsim进行时序仿真

7.2.8 modelsim仿真工具高级应用

7.3 综合的概念与synplify/synplify pro综合工具

7.3.1 synplify/synplify pro的功能与特点

7.3.2 synplify pro的用户界面

7.3.3 synplify pro综合流程

7.3.4 synplify pro的其他综合技巧

7.4 小结

7.5 问题与思考

《Altera FPGA/CPLD设计（基础篇）（第2版）》结合作者多年工作经验，系统地介绍了fpga/cpld的基本设计方法。在介绍fpga/cpld概念的基础上，介绍了altera主流fpga/cpld的结构与特点，并通过丰富的实例讲解quartus ii与modelsim、synplify pro等常用eda工具的开发流程。
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